问答题什么是综合？是否任何符合语法的VerilogHDL程序都可以综合？
问答题为什么说VerilogHDL的语言结构可以支持构成任意复杂的数字逻辑系统？
问答题不可综合成为电路的Verilog模块有什么好处？
问答题每种类型的VerilogHDL各有什么特点？主要用于什么场合？
问答题VerilogHDL的模型共有哪几种类型（级别）？
