A.Verilog HDL支持过程赋值和连续赋值两种赋值B.force release 仅用于debug，对寄……

单项选择题不符合时钟信号分配原则的是（）。

A.使用全局时钟，通过BUFG驱动，时钟信号到达各个寄存器的延迟相同
B.尽量使用时钟双沿触发提高效率
C.减少时钟信号种类
D.避免使用门控时钟

单项选择题不属于用户约束文件（.ucf文件）所包含内容的是（）。

A.时序约束
B.面积约束
C.物理约束
D.引脚约束

单项选择题‌关于ModelSim行为仿真说法错误的是（）。

A.忽略源代码中的时延语句
B.可以构造符合语法规范的任意模型描述
C.仿真文件没有输入输出端口描述
D.只能例化一个源文件的顶层Module

单项选择题‎关于LUT说法错误的是（）。

A.通过LUT的时间延迟是固定的
B.LUT包含在Slice中
C.不可以直接对LUT原语进行例化
D.4输入LUT可以完成16种逻辑运算

单项选择题‎关于MicroBlaze处理器说法错误的是（）。

A.MicroBlaze和PowerPC一样固化在FPGA芯片中
B.MicroBlaze是32位RISC处理器
C.MicroBlaze是Xilinx的嵌入式处理器软核
D.MicroBlaze可以进行裁剪定制